CPUとか今の4倍の大きさでも困らん思う

2025年02月15日22:01

カテゴリ:
購入・故障・相談・雑談
CPU

コメント(48) 　

1: Socket774 2025/02/13(木) 14:48:30.75 ID:vgcBmFFu

排熱もやりやすそうだし

2: Socket774 2025/02/13(木) 16:54:53.49 ID:4kzJ5D09

面積よりも厚さを今の倍盛っても、別に問題ないと思うの。それで性能がどうなるかは知らんw

3: Socket774 2025/02/13(木) 16:55:42.75 ID:zxcMO1Dr

昔ファミコンカセットみたいなCPUの時代があってな

4: Socket774 2025/02/14(金) 01:42:30.16 ID:QOTmqvya

コア数半分に減らしてダイ面積を4倍にしたら1コアあたり8倍のトランジスタ数使える
どんだけ性能上がるか夢が広がりまくる

5: Socket774 2025/02/14(金) 01:58:00.43 ID:qCi3X9Kg

なんで大きくしないの？

6: Socket774 2025/02/14(金) 02:46:14.00 ID:qEGAUqJA

何枚切り出せるかの方が重要
あと排熱問題と消費電力上がるだけ
コスパ考えて今のサイズ

14: Socket774 2025/02/14(金) 16:46:39.02 ID:spgYSaYq

>>6
一度にたくさん作るのは半導体と王道だが
単機能をたくさん組み合わせる方法の場合、組み立てる配線部分で面積的なロスが出る
その場合一気に作ったほうがよい。端子数が少ないSDIなら中に回路を詰め込んでも差し支えないが

7: Socket774 2025/02/14(金) 09:19:08.92 ID:QOTmqvya

GPUは800mm2近いダイ面積で作ったりしてる
それと比べるとCPUのダイ面積は50~200mm2程度が主流
もっと大きくできるはずよ
スレ主が言ってる4倍って数字は意外と的外れではない

8: Socket774 2025/02/14(金) 09:27:03.75 ID:bTPandKE

>>7
300Wとか使っていいなら

9: Socket774 2025/02/14(金) 15:14:51.83 ID:0nUOAWwB

コアを増やすんじゃなくて1コアあたりの性能を極めて欲しい

12: Socket774 2025/02/14(金) 16:41:16.78 ID:spgYSaYq

>>9
２つある
１，クロックを上げる　ただし上げすぎは電力効率が悪い
２，命令当たりのクロック数を下げる

23: Socket774 2025/02/15(土) 19:52:49.54 ID:NhnS1X0Y

>>9
クロックを上げられなくなったから
並列処理でなんとかするようになった

できるならやってるわ
2GHzあたりまではドンドン上がっていったわ

ムーアの法則は止まったっての

10: Socket774 2025/02/14(金) 16:31:50.12 ID:1BO2OW66

ダイ面積増やしたら歩留まり悪くなるやん

11: Socket774 2025/02/14(金) 16:36:37.01 ID:spgYSaYq

そんな時はＲＯＭで切り捨てる。使えるところだけ有効にする方法をとるのみ

13: Socket774 2025/02/14(金) 16:41:58.62 ID:DRRdULne

あの金属の部分だけ4倍にしとけば1を騙せるやろ

15: Socket774 2025/02/14(金) 17:17:00.74 ID:NmEFRMHU

GPUでCPUがやってることやらせたらクソ遅いしな
機能絞ったDOSで良ければ並列処理で高速とかありだが

16: Socket774 2025/02/15(土) 06:16:28.70 ID:qA8pME9k

熱はともかくcpuってなんでこんなに遅いんだろ電子って光速なんだよな

21: Socket774 2025/02/15(土) 09:05:35.27 ID:lWJVbJcQ

>>16
むしろGPUがワッパ悪くて遅いでしょ
50Wで今の性能でないと

18: Socket774 2025/02/15(土) 06:39:02.92 ID:+cJaNLgR

銅線の中を伝わる電気信号は、光の約3分の2の速度で伝わります。
光速約３０万ｋｍ/秒として、銅線中では２０万
１ナノ秒当たり２００メートルしか進めない
大規模な回路を行ったり来たりするには中々ツラい遅さ

20: Socket774 2025/02/15(土) 08:35:54.23 ID:zN9HS8rk

有名な話ですが
もうここから先CPU性能は伸びません
勿論2倍か4倍か10倍か、まぁ良くなったかな？程度の微差での進化は残されてますが
もう50年間でCPUの性能が100万倍上がったような、劇的な進化は物理的に不可能なのです（※トランジスタをこれ以上小さくどうやっても出来ない）
これはムーアの法則のムーア自体が亡くなる前に「もう分かってると思うけど、これ以上無理やで」と遺して亡くなったのを見ても分かるように
その通りになってますよね。

てすのでIntelはもしかしたら、それを見越してもう畳む準備をしてる可能性もあります。

22: Socket774 2025/02/15(土) 12:52:07.14 ID:FAubGZcy

cpuがでかい頃の方が安かったまである

24: Socket774 2025/02/15(土) 19:53:51.71 ID:8TOupXhX

Xeonでもスリッパでもお好きなものをどうぞ

25: Socket774 2025/02/15(土) 20:44:52.22 ID:lWJVbJcQ

XeonならIO帯域増やせるしね

17: Socket774 2025/02/15(土) 06:29:48.62 ID:Zrr/9cv5

大きくしたら価格も上がるだろ

19: Socket774 2025/02/15(土) 08:27:02.02 ID:qA8pME9k

発展を阻害するのはいつもコストだな

引用元: https://egg.5ch.net/test/read.cgi/jisaku/1739425710/

AMD Ryzen Threadripper PRO 7995WX 2.5GHz 96コア / 192スレッド 482MB 350W 3年保証 100-100000884WOF

AMD

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コメント一覧 (48)

- 1. 774の自作er
- 2025年02月15日 22:36
- 歩留まりというものがありまして・・・
- 0
  
  wavefanc
  
  がしました
- - 34. 774の自作er
  - 2025年02月16日 03:52
  - >>1
    面積4倍って正式な計算方法わからないけど
    歩留まり1/16ぐらいになりそうだよなｗ
    　
    かなり適当計算だけど　
    4倍の速度のCPUを手にするのに20倍近いお値段が払えるかという話だな
  - 0
    
    wavefanc
    
    がしました
- - 42. 774の自作er
  - 2025年02月16日 11:42
  - >>34
    そうならないためにMCMをどこも導入してるんだろ
    zen6ではブリッジ導入して更に性能上がるみたいだし
  - 0
    
    wavefanc
    
    がしました
- - 43. 774の自作er
  - 2025年02月16日 12:11
  - >>34
    チップ数が減るのと歩留まりが減るとは言いませんよ
    面積4倍と1辺4倍が区別できてないようだし
  - 0
    
    wavefanc
    
    がしました
- - 48. 774の自作er
  - 2025年02月16日 18:24
  - >>34
    欠陥の場所が十分に分散して存在したとすると、
    欠陥の割合は、欠陥の数/取れる個数になる。
    
    例えばウエハ上に欠陥が4か所ある場合、400個取れるなら不良率1％(許容範囲)、100個しか取れないなら不良率4%(許容範囲)になる。
    
    ウエハ上に欠陥が40か所ある場合、400個取れるなら不良率10％(許容範囲)、100個しか取れないなら不良率40%(歩留まり低過ぎ)になる可能性がある。
    
    ウエハ上に欠陥が100か所ある場合、400個取れるなら不良率25％(歩留まり低いが許容範囲かもしれない)、100個しか取れないなら不良率100%(1個も良品が取れない)になる可能性がある。
  - 0
    
    wavefanc
    
    がしました
- 2. 774の自作er
- 2025年02月15日 22:36
- とりあえず価格は4倍では効かないだろうな
- 0
  
  wavefanc
  
  がしました
- 3. 774の自作er
- 2025年02月15日 22:40
- CPU2枚載せとか4枚載せのマザボあるだろ
  最近ないんか？特定用とじゃないとメリットが無いんだよ
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  wavefanc
  
  がしました
- 4. 774の自作er
- 2025年02月15日 22:40
- シリコンサイズを4倍にしたら歩留まりが悪くなって不良品率上がるから、値段は4倍以上になるんだけど、そしたらイッチは絶対買わんやろ
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  wavefanc
  
  がしました
- 5. 774の自作er
- 2025年02月15日 22:44
- スロットCPUに利点はあったのか
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  wavefanc
  
  がしました
- - 14. 774の自作er
  - 2025年02月15日 23:34
  - >>5
    当時は大容量のキャッシュメモリを同じダイに組み込むのが難しかった
  - 0
    
    wavefanc
    
    がしました
- - 45. 774の自作er
  - 2025年02月16日 12:59
  - >>5
    昔はセカンドキャッシュがマザボに付いてた
    ↓CPUに近い方がスピードでるよね
    ↓CPUと一体にしたら速くならね？
    ↓やっぱ無理でしたーorz
    仕方がないからカセット型にした
    
    ソケット7なのにセカンドキャッシュ一体のK6-Ⅲって変なのもあったけどねw(マザボ側をサードキャッシュとして使用)
  - 0
    
    wavefanc
    
    がしました
- 6. 774の自作er
- 2025年02月15日 22:47
- 集積率上げるために微細化を進めてるのじゃなくて、駆動電圧を下げるために4nm,2nm,1nmと微細化してるんやで、性能が良くても推奨電源容量が1万Wとか嫌だろ
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  wavefanc
  
  がしました
- 7. 774の自作er
- 2025年02月15日 22:52
- 電子の移動速度は有限でこれ以上速くならない
  CPUパッケージの面積を大きくするとラグの原因になる
  そこでAMDはダイを広げず2階建とする事でラグを無くしつつキャッシュを大容量化できた
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  wavefanc
  
  がしました
- - 8. 774の自作er
  - 2025年02月15日 22:59
  - >>7
    なんで途中からキャッシュの話になったん？
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    wavefanc
    
    がしました
- - 11. 774の自作er
  - 2025年02月15日 23:15
  - >>8
    CPUパッケージが大きくなるとそれだけ電子の平面移動距離が増えます
    そうなるとメモリアクセスのラグが増えます
    でも3D V-CacheのようにCPUを大きくせず上下の移動に置き換えるとラグを増やさずトランジスタ数を増やす事ができます
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    wavefanc
    
    がしました
- - 29. 774の自作er
  - 2025年02月16日 01:42
  - >>7
    電子そのものは大したスピードでないはず
    光速なみのスピードは電圧の伝搬スピード
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    wavefanc
    
    がしました
- - 41. 774の自作er
  - 2025年02月16日 11:16
  - >>29
    どこかで導線中はありんこみたいな速度と聞いたことあるな。おしくら饅頭で伝播してるだけで。
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    wavefanc
    
    がしました
- - 47. 774の自作er
  - 2025年02月16日 16:26
  - >>41
    1Aといっても電子1個が持っている電荷から計算すると大した個数じゃないのな
  - 0
    
    wavefanc
    
    がしました
- 9. 774の自作er
- 2025年02月15日 23:05
- ダイサイズの大きさに比例して不良品も増える
  だから、小さいダイを複数個CPUパッケージに収めようという動きがトレンド
  そのためのI/Fも標準化が進んでる
- 0
  
  wavefanc
  
  がしました
- 10. 774の自作er
- 2025年02月15日 23:09
- 大きさ4倍のチップのお値段はいくらでしょうw
- 0
  
  wavefanc
  
  がしました
- 12. 774の自作er
- 2025年02月15日 23:16
- Slot2「ついに俺の時代が来たか・・・!」
  Slot1「お前じゃねえ座ってろ」
  SlotA「お前でもねえ座ってろ」
- 0
  
  wavefanc
  
  がしました
- 13. 774の自作er
- 2025年02月15日 23:19
- 消費電力も4倍なんよね？
  gpuの現状も含めたら一般人使えないよー
- 0
  
  wavefanc
  
  がしました
- 15. 774の自作er
- 2025年02月15日 23:34
- Skylake-X 7980XEとかの系統がそんな感じ
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  wavefanc
  
  がしました
- 16. 774の自作er
- 2025年02月15日 23:39
- ベンチマークサイトが去年初めてスコアーが前期を下回った。って言ってたな
  もう高性能CPUは求められてないんだよ
- 0
  
  wavefanc
  
  がしました
- - 26. 774の自作er
  - 2025年02月16日 01:06
  - >>16
    「スコアが前期を下回ったのは14世代どころか13世代にも負けている、Core Ultra 200シリーズのせいじゃねーの？」と思ったが
    Core Ultra 200シリーズ、ベンチマークのスコアだけは良かったな・・・
  - 0
    
    wavefanc
    
    がしました
- 17. 774の自作er
- 2025年02月15日 23:56
- CPUが128コアとか、ロマンではあるがいざ登場してみると使い道ないよね
- 0
  
  wavefanc
  
  がしました
- 18. 774の自作er
- 2025年02月16日 00:00
- ダイサイズ４倍は無しとしても、
  パッケージサイズ大きくしてオンパッケージメモリ搭載なCPUとかオンパッケージGPU搭載なCPUがあってもいいんじゃないかと思ってる
  sTR5ソケット使ってStrixHalo出ないかしら(マザボが高すぎて売れないから自作orBTO市場向けで出るならオンボマザーになるんだろうけど)
- 0
  
  wavefanc
  
  がしました
- - 28. 774の自作er
  - 2025年02月16日 01:23
  - >>18
    既にあるが？
    そもそもマルチコアにして、GPUを載せて、サウスも内蔵して、って無理をしてまで大きさを維持している、ってことを知らん奴が多すぎ
  - 0
    
    wavefanc
    
    がしました
- - 32. 774の自作er
  - 2025年02月16日 02:32
  - >>28
    サーバー向け＆ノート向けはノーカンでお願いします
    いまいちパッとしなかったeDRAM搭載Broadwellもノーカンでお願いします
    Kaby Lake-Gは悪くなかったと思う(自作/BTO市場には流れてこなかったけど)
  - 0
    
    wavefanc
    
    がしました
- - 33. 774の自作er
  - 2025年02月16日 02:33
  - >>28
    内蔵したのはサウスじゃなくてノースでしょお爺ちゃん
  - 0
    
    wavefanc
    
    がしました
- - 44. 774の自作er
  - 2025年02月16日 12:17
  - >>18
    RyzenAI Maxのメモリバス帯域幅が256GB/sでappleのM4pro並みだから
    出てくれればデスクトップでもM4macminiに対抗できるインパクトあるし
    出して欲しいんよねえ
  - 0
    
    wavefanc
    
    がしました
- 19. 774の自作er
- 2025年02月16日 00:00
- Zen6は1CCDで12コアになるから少し大きくなるかな
  それでもでもAM5だけどね
- 0
  
  wavefanc
  
  がしました
- 20. 774の自作er
- 2025年02月16日 00:01
- 大きくしたからと言って必ず性能上がる訳でもないし
  ポラックの法則、パイプラインの複雑性
  メモリ帯域の問題等ボトルネックになる事が多いんで
  期待するような物にはならない可能性の方が高い
  EPYC辺りは巨大なキャッシュがあるからやっと使い物になってる感じだし
  大きくしたら何もかも上手く行くなんて上手い話は無いんだよな
- 0
  
  wavefanc
  
  がしました
- 21. 774の自作er
- 2025年02月16日 00:02
- 9800X3DですらRTX5090のボトルネックになるらしいけどCPUの進化が止まったらこの先どうなるんだろ
  GPUは割とゴリ押しで性能上げられるけどCPUは厳しいよね?
- 0
  
  wavefanc
  
  がしました
- - 36. 774の自作er
  - 2025年02月16日 05:36
  - >>21
    ・アプリおよびドライバの処理をもっとマルチスレッド化する
    ・ドライバの処理の一部をGPUが負担する
  - 0
    
    wavefanc
    
    がしました
- 22. 774の自作er
- 2025年02月16日 00:05
- 大きくて高性能ならRyzen Threadripperとかあるやん
- 0
  
  wavefanc
  
  がしました
- 23. 774の自作er
- 2025年02月16日 00:29
- シリコンダイのサイズはそのままで、ヒートスプレッダを大きくするのも有りだとは思うがね
  Ryzen AIとノート用のCore Ultraがそうしてる。まぁメモリも入れてるから大きくなったんだが
- 0
  
  wavefanc
  
  がしました
- 24. 774の自作er
- 2025年02月16日 01:02
- 歩留まりが悪くなるし、１枚のウエハーから切り出せる量が1/4以下になりコスト高にもなる
  生産性も落ちるから現在の価格の4倍では済まないだろうね
  Xeonみたいな少数生産で生産コストをあまり気にしないCPUなら作れるだろうけど、
  一般向けとなると数を揃える必要があるから、4倍のサイズにするメリットは無い
  まだ製造プロセスを更に緻密化して多少歩留まりが悪化しても4倍にするより経済的
- 0
  
  wavefanc
  
  がしました
- 25. 774の自作er
- 2025年02月16日 01:06
- コアを増やすよりDRAMやチップセットを統合出来たらいいんだろうけど。
  あとは巨大な放熱板やヒートパイプとか。
- 0
  
  wavefanc
  
  がしました
- - 40. 774の自作er
  - 2025年02月16日 11:10
  - >>25
    昔はメモコンとPCIeコントローラーがノースブリッジとしてチップセットに含まれてたんだよ
    今のチップセットは昔で言うサウスブリッジの部分（ストレージとかを担当）
  - 0
    
    wavefanc
    
    がしました
- 27. 774の自作er
- 2025年02月16日 01:08
- 微細化が止まった次の選択肢としてはわからんが今はそれだとコストが増えるだけなのでNG
  サバ向けCPUは今でも普通にでかいからそのくらいにはやろうと思えばできるだろう
- 0
  
  wavefanc
  
  がしました
- 30. 774の自作er
- 2025年02月16日 01:58
- 途中のやつ計算間違ってるだろ
  １ナノ秒当たり２００メートルじゃない20cmだ
  4GHｚなら5cmしか動かない
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  wavefanc
  
  がしました
- 31. 774の自作er
- 2025年02月16日 02:04
- M1とかもでかいんだっけ
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  wavefanc
  
  がしました
- 35. 774の自作er
- 2025年02月16日 05:07
- CCDとIODに分けてダイサイズを最小限に維持するAMDと、
  複数タイルを張り合わせてまでダイサイズを最大限に維持するIntelの設計思想の違い。
- 0
  
  wavefanc
  
  がしました
- 37. 774の自作er
- 2025年02月16日 08:05
- x64の枠組みを捨てて別の命令セットを使うのなら
  少し様子が変わるかもしれない
  理研のスパコン富岳のCPUは並列処理機能を大幅に強化した省エネのARMチップだから
  もう少し熱処理で効率化できるかもしれない
- 0
  
  wavefanc
  
  がしました
- - 39. 774の自作er
  - 2025年02月16日 10:53
  - >>37
    あんまり変わらないと思うよ
    富岳のCPUは標準的なARMと独自のSIMD命令セットで構成されてる
    ARMのSIMD命令が貧弱だったから独自命令セット入れただけなので
    x86、x64の命令セットの見直しは必要だと思うけど
    x64はAVXという強力なSIMD命令セットあるので
    富岳のCPUと同じ事をしてもそんなに効果無いと思うよ
    SIMD命令はソフトウェア側も対応必要だし
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    wavefanc
    
    がしました
- 38. 774の自作er
- 2025年02月16日 10:11
- デカいとコストもデカくなる
  原料や輸送諸々
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  wavefanc
  
  がしました
- 46. 774の自作er
- 2025年02月16日 14:57
- 俺らが考えつく思い付きを！！IntelとAMDの技術者が考え付かないわけないだろっ！！
  
  よく知らないけどあいつら多分マサチューッっセッシュ工科大学とかインドのすげー大学の中でも上澄みの中の上澄みだぞ！
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  wavefanc
  
  がしました